Mudanças entre as edições de "DLP29006-Engtelecom(2019-2) - Prof. Marcos Moecke"
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===Unidade 1 - Introdução a disciplina=== | ===Unidade 1 - Introdução a disciplina=== | ||
− | * | + | * 3 AULAS |
− | ;Aula 1 ( | + | ;Aula 1 (29 jul): |
− | *[[DLP1-EngTel (Plano de Ensino) | Apresentação da disciplina]] | + | * [[DLP1-EngTel (Plano de Ensino) | Apresentação da disciplina]] |
− | * | + | * Os materiais, prazos, documentação, histórico de trabalhos anteriores estão publicados nesta wiki. |
+ | * A [[DLP1-EngTel (página) | página da disciplina de DLP1]] contem os materiais que não alteram entre semestre. | ||
+ | * Nesta página está o [[DLP29006-Engtelecom(2019-2) - Prof. Marcos Moecke | Registro Diário e Avaliação]], que varia de semestre para semestre. | ||
+ | * Para a realização e entrega das atividades será utilizada a [https://moodle.sj.ifsc.edu.br/course/index.php?categoryid=177 Plataforma Moodle de DLP29006]. Auto inscrição na (engtelecom2019-2) | ||
+ | ;Aula 2 (31 jul): | ||
*Introdução aos dispositivos lógicos programáveis: | *Introdução aos dispositivos lógicos programáveis: | ||
:* Conceito, tipos de PLDs | :* Conceito, tipos de PLDs | ||
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;Aula 2 (15 fev): | ;Aula 2 (15 fev): | ||
* [[DLP1-EngTel_(página)#Quartus.2FModelsim.2FQSIM | Acesso a nova nuvem do IFSC]] | * [[DLP1-EngTel_(página)#Quartus.2FModelsim.2FQSIM | Acesso a nova nuvem do IFSC]] | ||
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;Curiosidades do mundo digital: | ;Curiosidades do mundo digital: | ||
*[https://www.computerhistory.org/siliconengine/timeline/ The Silicon Engine Timeline] | *[https://www.computerhistory.org/siliconengine/timeline/ The Silicon Engine Timeline] | ||
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Edição das 18h39min de 30 de julho de 2019
MURAL DE AVISOS E OPORTUNIDADES DA ÁREA DE TELECOMUNICAÇÕES
Registro on-line das aulas
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Unidade 1 - Introdução a disciplina
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Avaliações
Atividade Relâmpago (AR)
As atividades relâmpago são atividades avaliativas opcionais que darão BôNUS adicionais ao aluno na próxima avaliação. Elas normalmente consistem de soluções simples para algum problema ou sistema. Elas são enunciadas na aula, e o prazo e a entrega serão definidos no Moodle. Não são aceitas entregas tardias, e apenas 2 alunos podem receber o bonus. A pontuação das atividades é informada a cada atividade.
Avaliação A1
- Conteúdo avaliado serão as unidades 2 a 4 (cap 1 - 5)
- Data da avaliação (XX/XX/2019) - Local: LabSiDi.
Avaliação A2
- Conteúdo avaliado serão as unidades 5 a 7 (Cap 6 a 9)
- Data da avaliação (XX/XX/2019) - Local: LabSiDi.
Recuperação R12
- Esta avaliação somente será realizada se necessária, e deverá ser feita na última semana letiva do semestre
- Conteúdo avaliado será as unidades 2 a 7
- Data da avaliação (XX/XX/2019) - Local: LabSiDi.
- As avaliações A1 e A2 são com consulta apenas as folhas de consulta entregues:
- VHDL Quick Reference - SynthWorks
- VHDL Types and Operators Quick Reference - SynthWorks
- ModelSim Quick Reference - SynthWorks
- Tabelas das figuras 3.6, 3.10 e 4.1 do livro do Pedroni.
- Arquivo:Numeric std conversions.png
- Dica use também como fonte de consulta os templates do Quartus.
- Ao final das avaliações o aluno deverá enviar a avaliação para a plataforma Moodle com os arquivos solicitados.
Projeto Final (PF)
- O projeto final é uma atividade de avaliação desenvolvida em equipe, e consiste no desenvolvimento de um sistema que aplica os conhecimento adquiridos durante o semestre. A avaliação do projeto final corresponde a no mínimo 45% do peso no conceito final. São avaliados no projeto final os quesitos: 1) Sistema desenvolvido (projeto, simulação e realização, demostração do harware); 2) Relatório com a documentação completa do projeto; 3) A avaliação individual do aluno durante o desenvolvimento do projeto e/ou entrevista (avaliação oral).