Mudanças entre as edições de "DLP29007-2019-1"

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=Aula 10/04/2019 –  EXTRA (choque Prof. Noronha) =
 
=Aula 10/04/2019 –  EXTRA (choque Prof. Noronha) =
 
* [http://docente.ifsc.edu.br/roberto.matos/dlp2_public/list_07_06_07_08_09_diff.vhd Exercício Extra]
 
* [http://docente.ifsc.edu.br/roberto.matos/dlp2_public/list_07_06_07_08_09_diff.vhd Exercício Extra]
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=Aula 01/04/2019 –  Eficiência de Circuitos Combinacionais (cont.) =
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*Leitura recomendada:
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**Capítulo 7 do livro do Chu;
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**Notas de aula 03.
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* [http://docente.ifsc.edu.br/roberto.matos/dlp2_public/slides/dlp29007-lecture03-efficient_comb_circuits.pdf Lecture 03: Efficient Design of Combinational Circuits]
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* [http://docente.ifsc.edu.br/roberto.matos/dlp2_public/pratica_cap7.zip Prática Cap. 7]

Edição das 08h09min de 12 de abril de 2019

Dispositivos Lógicos Programáveis 2

Usando os Kits de FPGA

Aula 11/02/2019 – Aula Cancelada

  • Afastamento visita técnica.

Aula 15/02/2019 – Apresentação

  • Apresentação do professor.
  • Apresentação da disciplina.
  • Projetos com FPGA


Aula 18/02/2019 – Complexidade e Projeto de Sistemas Digitais


Aula 25/02/2019 – Tempos de Propagação e Logic Lock

Aula 28/02/2019 – Tempos de Propagação e Logic Lock (cont.)

  • Definir tempos de propagação para os seguintes casos:
    • Circuito original
    • Constraint de Tempo
    • Logic lock original
    • Logic lock com Constraint de Tempo
  • Para cada circuito acima fazer a análise do delay:
    • Dos pinos de entrada até a saída
    • Da "entrada" até a "saída" do circuito


Aula 11/03/2019 – Prática Signal Tap

  • PROBLEMA: /etc/udev/rules.d/altera-usb-blaster.rules

Aula 15/03/2019 – Síntese do VHDL


Aula 25/03/2019 – Síntese do VHDL (cont.)

Aula 29/03/2019 – Atividade 1

Aula 01/04/2019 – Eficiência de Circuitos Combinacionais


Aula 08/04/2019 – Eficiência de Circuitos Combinacionais (cont.)

Aula 10/04/2019 – EXTRA (choque Prof. Noronha)


Aula 01/04/2019 – Eficiência de Circuitos Combinacionais (cont.)