Mudanças entre as edições de "SST20707-2013-1"
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<br>'''Atendimento paralelo:''' 4a de 13:30 às 15:20. | <br>'''Atendimento paralelo:''' 4a de 13:30 às 15:20. | ||
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Edição das 23h57min de 15 de agosto de 2013
Síntese de Sistemas de Telecomunicações: Diário de Aula 2013-2
Professor: Roberto de Matos
Encontros: 3a feira 9:40 e 6a feira 7:30
Atendimento paralelo: 4a de 13:30 às 15:20.
Assuntos trabalhados
- Introdução aos dispositivos lógicos programáveis
- Introdução à tecnologia FPGA
- Introdução a linguagem VHDL
- Estrutura da linguagem
- Códigos VHDL para uso nas Aulas
- Aritmética com vetores em VDHL
- Geração automática de TestBench para projetos VHDL
- Inicialização de memória com arquivos .MIF e .HEX
- Exemplo de uso de memória para a geração de sinais
- Tipos de dados no VHDL;
- Processos
- Hierarquia
- Aritmética computacional
- Alguns Exemplos de VHDL
Aula 1: Apresentação
- Apresentação do professor.
- Apresentação da disciplina: conteúdo, bibliografia e avaliação.
- Apresentação dos alunos: Nome, perfil, preferências, etc.
- Aula Introdutória:
- Por que dispositivos lógicos programáveis?
- Histórico