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- 14h54min de 29 de outubro de 2020 dif his -1 MIC29004-2020-1 →Aula 03/02/2019: Correções e Prática atual
- 00h17min de 27 de agosto de 2020 dif his +35 Setup Ferramentas AVR para Assembly atual
- 00h15min de 27 de agosto de 2020 dif his -44 Setup Ferramentas AVR para Assembly
- 15h51min de 7 de abril de 2020 dif his +28 PJI29006-2020-1 →Página dos Grupos atual
- 15h35min de 7 de abril de 2020 dif his +26 PJI29006-2020-1 →Aula 07/04/2019: Definição do Projeto
- 15h34min de 7 de abril de 2020 dif his +517 PJI29006-2020-1 →Aula 07/04/2019: Definição do Projeto
- 15h29min de 7 de abril de 2020 dif his +11 PJI29006-2020-1 →Aula 07/04/2019: Definição do Projeto
- 15h28min de 7 de abril de 2020 dif his +960 PJI29006-2020-1 →Aula 03/03/2019: Seminários e Especificação do Projeto
- 12h54min de 12 de março de 2020 dif his +110 MIC29004-2020-1 →Aula 05/02/2019: Introdução à Arquitetura e Organização de Computadores
- 11h20min de 11 de março de 2020 dif his +104 DLP29007-2020-1 →Aula 03/03/2020 – Síntese do VHDL (cont.) atual
- 15h07min de 5 de março de 2020 dif his +36 MIC29004-2020-1 →Aula 05/02/2019: Introdução à Arquitetura e Organização de Computadores
- 15h04min de 5 de março de 2020 dif his +632 MIC29004-2020-1 →Aula 03/02/2019: Introdução à Arquitetura de Computadores
- 22h30min de 4 de março de 2020 dif his -6 PJI29006-2020-1 →Atividade (Próxima Aula):
- 23h16min de 3 de março de 2020 dif his +3 PJI29006-2020-1
- 23h15min de 3 de março de 2020 dif his +1 981 PJI29006-2020-1
- 22h50min de 3 de março de 2020 dif his -29 STE-EngTel (página) Limpou toda a página atual Etiqueta: anulando
- 22h29min de 2 de março de 2020 dif his 0 DLP29007-2020-1 →Aula 02/03/2020 – Síntese do VHDL (cont.)
- 22h15min de 2 de março de 2020 dif his +551 DLP29007-2020-1 →Aula 18/02/2020 – Síntese do VHDL
- 22h05min de 2 de março de 2020 dif his -108 DLP29007-2020-1 →Aula 18/02/2020 – Síntese do VHDL
- 21h10min de 2 de março de 2020 dif his 0 MIC29004-2020-1 →Aula 27/02/2019: Introdução à Arquitetura de Computadores