Mudanças entre as edições de "Usuário:Lucas.lv"

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Edição das 18h21min de 21 de setembro de 2015

Horários

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Projetos

Implementação de Sistemas de Telecomunicações Digitais Utilizando Simulink e HDL Coder

Página do projeto:- Implementação de Sistemas de Telecomunicações Digitais Utilizando Simulink e HDL Coder.

Professor orientador - Marcos Moecke

Reunião Semanal de Orientação - Quinta-feira das 10h30 as 11h45.

Orientações

  • Formatar a pagina do projeto baseado em [1]
  • Estudar os PLDs e VHDL (Cap 18 e 19 do Pedroni).
  • Ler o Projeto enviado pelo Email
  • Ler o artigo "FPGA Implementation of a Hybrid Sensorless Control of SMPMSM in the Whole Speed Range" focado na parte do HDL Coder.
  • Para os estudos de VHDL utilizar o software Quartus II, usando o Acesso ao IFSC-CLOUD
  • Seguir o Tutorial da Altera sobre o Quartus II - Programação VHDL
  • Seguir o Tutorial da Altera sobre o Quartus II - Simulação com QSIM
  • Pegar CD para formatar a máquina
  • Aprender a programar o KIT FPGA [2], e configurar o computador [3].
  • Estudar o Modelsim para utilizar posteriormente na simulação do código VHDl gerado pelo Matlab [4] e [5]
  • Estudar o HDL Coder para matlab [6] - Aula 34 e 35 (9 e 10 jun)
  • Estudar o HDL Coder para Simulink [7], [8].
  • Criar login na Mathworks.

Emprestimos

  • PEDRONI, Volnei A. Circuit Design with VHDL; ed. [S.l]:MIT, 2004. p. ISBN 9780262162241
  • Kit Educadional DE0-Nano
  • CD instalação do UBUNTU 14.04 64 bits.

Lembretes pessoais

  • Criar uma tabela comparativa entre os blocos

Relatórios semanais de atividades

Relatórios de agosto
Relatório semanal de atividades - 03/08/15 - 07/08/15
  • Dia 05/08:
    • Continuação do Cap 19 (Pedroni)
    • Implementação de circuitos lógicos básicos para fixação de entidade e arquitetura
  • Dia 07/08:
    • Continuação do Cap 19 (Pedroni)
Relatório semanal de atividades - 10/08/15 - 14/08/15
  • Dia 10/08:
    • ---- Reposição no dia 11 ----
  • Dia 11/08:
    • Inicio das leituras dos tutorias do Quartus (Via IFSC-CLOUD)
    • Continuação do Cap 19 (Pedroni)
    • Aplicação dos exemplos do capítulo 19
    • Aplicação de outros circuitos lógicos simples
  • Dia 12/08:
    • Continuação dos tutoriais do Quartus (Via IFSC-CLOUD)
  • Dia 13/08:
    • Continuação dos tutoriais do Quartus (Via IFSC-CLOUD)
  • Dia 14/08:
    • Finalização dos tutoriais do Quartus (Via IFSC-CLOUD)
    • Formatação da máquina
    • Início da programação na FPGA
    • Criação do login na Mathworks
Relatório semanal de atividades - 17/08/15 - 21/08/15
Relatório semanal de atividades - 24/08/15 - 28/08/15
Relatório semanal de atividades - 31/08/15 - 4/09/15
  • Dia 31/08:
    • Estudo HDL coder
      • Gerar código VHDL usando o simulink.
        • Foi gerado um código simples, simulando uma função transferência de um somador utilizando AmpOp
  • Dia 01/08:
    • Continuação HDL coder
      • Estudo do workflow advisor
      • Conversão para ponto fixo
  • Dia 02/08:
    • HDL coder
  • Dia 03/08:
    • Continuação HDL coder
    • início HDL verifier
    • Pesquisa de blocos exemplo
  • Dia 04/08:
    • Continuação HDL coder
    • continuação HDL verifier
Relatório semanal de atividades - 07/09/15 -11/09/15
  • Dia 07/09:
    • Feriado
  • Dia 08/08:
    • Continuação HDL coder
    • continuação HDL verifier
  • Dia 09/08:
    • Continuação HDL coder
    • continuação HDL verifier
  • Dia 10/08:
    • Continuação HDL coder
    • continuação HDL verifier
      • Gerar TB e simular do vsim
  • Dia 11/08:
    • Continuação
Relatório semanal de atividades - 14/09/15 -18/09/15
  • Dia 14/08:
    • Continuação dos tutoriais e uso do Vsim para simulador os códigos gerados
  • Dia 15/08:
    • Pesquisa sobre Communications System Toolbox
    • Procura de novas literaturas
  • Dia 16/08:
    • Tutoriais Communications System Toolbox
  • Dia 17/08:
  • Estudo sobre Communications System Toolbox
  • http://www.mathworks.com/help/comm/ref/bernoullibinarygenerator.html
Relatório semanal de atividades - 21/09/15 -25/09/15
  • Dia 21/08:
    • Leitura do help sobre suporte HDL coder

Simulink

  • Blocos com algum suporte ao HDL coder:
Bloco Suporte HDL Coder no MATLAB 2014 Suporte HDL Coder no MATLAB 2015 Blocos suportados MATLAB 2014 Blocos suportados MATLAB 2015
Continuous Não Não - -
Dashboard Não Não - -
Discontinuities Sim Sim 3 9
Discrete Sim Sim 12 12
Logic and Bit Operations Sim Sim 9 9
Lookup Tables Sim Sim 7 7
Math Operations Sim Sim 30 29
Model Verification Sim Sim 11 11
Model-Wide Utilities Sim Sim 2 2
Ports & Subsystems Sim Sim 9 10
Signal Attributes Sim Sim 6 6
Signal Routing Sim Sim 11 12
Sinks Sim Sim 9 9
Sources Sim Sim 6 6
User-Defined Functions Sim Sim 2 2
Discontinuities
Sub-bloco Suporte HDL Coder no MATLAB 2014 Suporte HDL Coder no MATLAB 2015
Backlash Não Sim
Coulomb & Viscous Friction Não Sim
Dead Zone Não Sim
Dead Zone Dynamic Não Sim
Hit Crossing Não Sim
Quantizer Não Não
Rate Limiter Não Não
Rate Limiter Dynamic Não Não
Relay Sim Sim
Saturation Sim Sim
Saturation Dynamic Sim Sim
Wrap To Zero Não Sim
Discrete
Sub-bloco Suporte HDL Coder no MATLAB 2014 Suporte HDL Coder no MATLAB 2015
Delay Sim Sim
Difference Não Não
Discrete Derivative Não Não
Discrete Filter Não Não
Discrete FIR Filter Sim Sim
Discrete PID controller Sim Sim
Discrete PID Controller (2D0F) Não Não
Discrete State-Space Não Não
Discrete Transfer Fcn Sim Sim
Discrete Zero-Pole Não Não
Discrete-Time Integrator Sim Sim
Enabled Delay Não Não
First-Order Hold Não Não
Memory Sim Sim
Resettable Delay Não Não
Tapped Delay Sim Sim
Transfer Fcn First Order Não Não
Transfer Fcn Lead or Lag Não Não
Transer Fcn Real Zero Não Não
Unit Delay Sim Sim
Variable Integer Delay Não Não
Zero-Order Hold Sim Sim
  • Alguns blocos com suporte estão localizados em "Additional Math & Discrete" (Tanto na versão 2014, quanto na 2015). São eles:
      • Unit Delay
      • Unit Delay Enabled
      • Unit Delay Enabled Resettable
      • Unit Delay Resettable
Logic and Bit Operations
Sub-bloco Suporte HDL Coder no MATLAB 2014 Suporte HDL Coder no MATLAB 2015
Bit clear - -
Bit set - -
Bitwise Operator - -
Combinational logic - -
Compare to Constant - -
Compare to Zero - -
Detect Change - -
Detect Decrease - -
Detect Fall Negative - -
Detect Fall Nonpositive - -
Detect incrase - -
Detect Rise Nonnegative - -
Detect Rise Positive - -
Extract Bits - -
Internal Test - -
Interval Test Dynamic - -
Logical Operator - -
Relational Operator - -
Shift Arithmetic - -
Lookup Tables
Sub-bloco Suporte HDL Coder no MATLAB 2014 Suporte HDL Coder no MATLAB 2015
1-D Lookup Table - -
2-D Lookup Table - -
Cosine - -
Direct Lookup Table (n-D) - -
Interpolation Using Prelookup - -
Lookup Table Dynamic - -
n-D Lookup Table - -
Prelookup - -
Sine - -
Math Operations
Sub-bloco Suporte HDL Coder no MATLAB 2014 Suporte HDL Coder no MATLAB 2015
Abs - -
Add - -
Algebraic Constraint - -
Assignment - -
Bias - -
Complex to Magnitude-Angle - -
Complex to Real-lmag - -
Divide - -
Dot Product - -
Find Nonzero Elements - -
Gain - -
Magnitude-Angle to Complex - -
Math function - -
Matrix Concatenate - -
MinMax - -
MinMax Running Resettable - -
Permute Dimensions - -
Polynomial - -
Product - -
Product of Elements - -
Real-Imag to Complex - -
Reciprocal Sqrt - -
Reshape - -
Rounding Function - -
Sign - -
Signed sqrt - -
Sine Wave Function - -
Slider Gain - -
Sqrt - -
Squeeze - -
Subtract - -
Sum - -
Sum of Elements - -
Trigonometric Function - -
Unary Minus - -
Vector Concatenate - -
Weighted Sample Time Math - -
Model Verification
Model-Wide Utilities
Ports & Subsystems
Signal Attributes
Signal Routing
Sinks
Sources
User-Defined Functions


Communications System Toolbox