Usuário:Lucas.lv

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Implementação de Sistemas de Telecomunicações Digitais Utilizando Simulink e HDL Coder

Página do projeto:- Implementação de Sistemas de Telecomunicações Digitais Utilizando Simulink e HDL Coder. Professor orientador - Marcos Moecke Reunião Semanal de Orientação - Quinta-feira das 10h30 as 11h45. Orientações Formatar a pagina do projeto baseado em [1] Estudar os PLDs e VHDL (Cap 18 e 19 do Pedroni). Ler o Projeto enviado pelo Email Ler o artigo "FPGA Implementation of a Hybrid Sensorless Control of SMPMSM in the Whole Speed Range" focado na parte do HDL Coder. Para os estudos de VHDL utilizar o software Quartus II, usando o Acesso ao IFSC-CLOUD Seguir o Tutorial da Altera sobre o Quartus II - Programação VHDL Seguir o Tutorial da Altera sobre o Quartus II - Simulação com QSIM Pegar CD para formatar a máquina Aprender a programar o KIT FPGA [2], e configurar o computador [3]. Estudar o Modelsim para utilizar posteriormente na simulação do código VHDl gerado pelo Matlab [4] e [5] Estudar o HDL Coder para matlab [6] - Aula 34 e 35 (9 e 10 jun) Estudar o HDL Coder para Simulink [7], [8]. Criar login na Mathworks. Emprestimos PEDRONI, Volnei A. Circuit Design with VHDL; ed. [S.l]:MIT, 2004. p. ISBN 9780262162241 Kit Educadional DE0-Nano CD instalação do UBUNTU 14.04 64 bits. Relatórios semanais de atividades Relatório semanal de atividades - 03/08/15 - 07/08/15 Dia 03/08: Formatação da página do projeto Leitura do Cap 18 (Pedroni) Leitura do projeto Estudo complementar baseado em: https://www.youtube.com/watch?v=80slhBSl4VQ&list=PLQ4bYmp0mquJEx7wLG8E8t3Un7GW5Z3pm&index=2 Inicio Cap 19 (Pedroni) Dia 04/08: Continuação do Cap 19 (Pedroni) Estudo complementar baseado em: https://www.youtube.com/watch?v=2usqQE7ZQP8&list=PLQ4bYmp0mquJEx7wLG8E8t3Un7GW5Z3pm&index=5 https://www.youtube.com/watch?v=CpDiyF0GyDs&list=PLQ4bYmp0mquJEx7wLG8E8t3Un7GW5Z3pm&index=6 Roberto d'Amore, VHDL Descrição e Síntese de Circuitos Digitais. 2º edição. Adoção do cronograma de atividades de DLP 1 (2015-1) por organização. Disponível em: Cronograma Dia 05/08: Continuação do Cap 19 (Pedroni) Implementação de circuitos lógicos básicos para fixação de entidade e arquitetura Dia 06/08: Continuação do Cap 19 (Pedroni) Estudo complementar baseado em: http://vhdl.com.br/site/ Dia 07/08: Continuação do Cap 19 (Pedroni) Relatório semanal de atividades - 10/08/15 - 14/08/15 Dia 10/08: ---- Reposição no dia 11 ---- Dia 11/08: Inicio das leituras dos tutorias do Quartus (Via IFSC-CLOUD) Continuação do Cap 19 (Pedroni) Aplicação dos exemplos do capítulo 19 Aplicação de outros circuitos lógicos simples Dia 12/08: Continuação dos tutoriais do Quartus (Via IFSC-CLOUD) Dia 13/08: Continuação dos tutoriais do Quartus (Via IFSC-CLOUD) Dia 14/08: Finalização dos tutoriais do Quartus (Via IFSC-CLOUD) Formatação da máquina Início da programação na FPGA Criação do login na Mathworks Relatório semanal de atividades - 17/08/15 - 21/08/15 Dia 17/08: Leitura do livro "Circuit Design and Simulation with VHDL" Inicio do tutorial do ModelSim [9] Estudo complementar baseado em: https://www.youtube.com/watch?v=Z8whdGa7RtY Dia 18/08: Finalização do tutorial do ModelSim [10] Leituras complementares indicadas em [11] aula 31. Início de leitura do cap 10 do livro "Circuit Design and Simulation with VHDL" Dia 19/08: ---- Reposição no dia 20 ---- Dia 20/08: Criação de um login na Mentor Graphics Estudo do ModelSim baseado em um vídeo da Mentor Graphics [12] Início do tutorial [13] Leitura do quick guide disponível em [14] Início do estudo sobre testbenches (baseado no livro "Circuit Design and Simulation with VHDL")