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- 16h13min de 5 de abril de 2019 dif his +85 STE29008-2019-1
- 15h26min de 5 de abril de 2019 dif his +71 STE29008-2019-1 →03/04/2019 – Classe GPIO
- 17h11min de 4 de abril de 2019 dif his -11 MIC29004-2019-1 →Aula 04/04/2019: Arquitetura e Organização do BIP II
- 17h10min de 4 de abril de 2019 dif his 0 MIC29004-2019-1 →Aula 03/04/2019: Montar assembly do BIP
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- 13h47min de 3 de abril de 2019 dif his +33 STE29008-2019-1 →27/03/2019 – Auxílio Atividade (Interrupção)
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- 09h38min de 1 de abril de 2019 dif his +21 DLP29007-2019-1
- 08h04min de 1 de abril de 2019 dif his -3 DLP29007-2019-1 →Aula 01/04/2019 – Eficiência de Circuitos Combinacionais
- 07h46min de 1 de abril de 2019 dif his +420 DLP29007-2019-1 →Aula 25/03/2019 – Síntese do VHDL (cont.)
- 12h45min de 28 de março de 2019 dif his +353 DLP29007-2019-1 →Dispositivos Lógicos Programáveis 2
- 11h17min de 28 de março de 2019 dif his +2 PJI29006-2019-1 →Aula 25/03/2019: Avaliação do Andamento (Casos de Uso do SS)
- 10h47min de 28 de março de 2019 dif his +533 PJI29006-2019-1 →Aula 25/03/2019: Avaliação do Andamento (Casos de Uso do SS)
- 15h22min de 27 de março de 2019 dif his +30 MIC29004-2019-1 →Aula 27/03/2019: Organização do BIP
- 15h21min de 27 de março de 2019 dif his +43 MIC29004-2019-1 →Aula 21/03/2019: Organização do BIP
- 15h16min de 27 de março de 2019 dif his +11 STE29008-2019-1 →27/03/2019 – Auxílio Atividade (Interrupção)
- 19h54min de 24 de março de 2019 dif his 0 DLP29007-2019-1 →Aula 18/03/2019 – Síntese do VHDL (cont.)