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- 15h19min de 23 de março de 2021 (dif | his) . . (0) . . Projetos Finais CIL29003
- 09h17min de 23 de março de 2021 (dif | his) . . (0) . . Projetos Finais CIL29003
- 09h15min de 23 de março de 2021 (dif | his) . . (0) . . Projetos Finais CIL29003
- 11h05min de 23 de fevereiro de 2021 (dif | his) . . (+39) . . Circuitos Lógicos Aritméticos (atual)
- 10h30min de 17 de fevereiro de 2021 (dif | his) . . (+40) . . Circuitos Lógicos Aritméticos
- 10h28min de 17 de fevereiro de 2021 (dif | his) . . (+121) . . Circuitos Lógicos Aritméticos
- 10h44min de 23 de dezembro de 2020 (dif | his) . . (+56) . . Experimento 5 para Circuitos Lógicos
- 11h01min de 21 de dezembro de 2020 (dif | his) . . (-16) . . Experimento 5 para Circuitos Lógicos
- 14h33min de 22 de setembro de 2020 (dif | his) . . (+30) . . Configuração da USB para programação do FPGA via JTAG (atual)
- 09h35min de 10 de setembro de 2020 (dif | his) . . (-3) . . Projetos Finais CIL29003
- 09h34min de 10 de setembro de 2020 (dif | his) . . (+1) . . Projetos Finais CIL29003
- 09h33min de 10 de setembro de 2020 (dif | his) . . (+12) . . Projetos Finais CIL29003
- 09h31min de 10 de setembro de 2020 (dif | his) . . (+791) . . Projetos Finais CIL29003
- 13h26min de 8 de setembro de 2020 (dif | his) . . (0) . . CIL-EngTel (página) (→Aulas de Laboratório)
- 13h25min de 8 de setembro de 2020 (dif | his) . . (+353) . . CIL-EngTel (página) (→Aulas de Laboratório)
- 12h28min de 27 de agosto de 2020 (dif | his) . . (+32) . . CIL-EngTel (página) (→Aulas de Laboratório)
- 12h26min de 27 de agosto de 2020 (dif | his) . . (-422) . . CIL-EngTel (página) (→Aulas de Laboratório)
- 10h18min de 27 de agosto de 2020 (dif | his) . . (+189) . . CIL-EngTel (página) (→Aulas de Laboratório)
- 10h13min de 27 de agosto de 2020 (dif | his) . . (+2) . . CIL-EngTel (página) (→Aulas de Laboratório)
- 10h12min de 27 de agosto de 2020 (dif | his) . . (+338) . . CIL-EngTel (página) (→Aulas de Laboratório)
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