Mudanças entre as edições de "Cronograma de atividades (DLP2-EngTel)"
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{{Cl|5 |20/10 | 2,4 | Eficiência de Circuitos Combinacionais | Lab. Programação, Kits FPGA}} | {{Cl|5 |20/10 | 2,4 | Eficiência de Circuitos Combinacionais | Lab. Programação, Kits FPGA}} | ||
{{Cl|6 |21/10 | 2 | Eficiência de Circuitos Combinacionais | Lab. Programação, Kits FPGA}} | {{Cl|6 |21/10 | 2 | Eficiência de Circuitos Combinacionais | Lab. Programação, Kits FPGA}} | ||
− | {{Cl|7 |27/10 | 2 | Eficiência de Circuitos Combinacionais | Lab. Programação, Kits FPGA}} | + | {{Cl|7 |27/10 | 2,4 | Eficiência de Circuitos Combinacionais | Lab. Programação, Kits FPGA}} |
− | {{Cl|8 | | + | {{Cl|8 |28/10 | 2 | Eficiência de Circuitos Sequenciais | Lab. Programação, Kits FPGA}} |
− | {{Cl|9 | | + | {{Cl|9 |3/11 | 2,4 | Eficiência de Circuitos Sequenciais | Lab. Programação, Kits FPGA}} |
− | {{Cl|10 |10/11 | 2 | Eficiência de Circuitos Sequenciais | Lab. Programação, Kits FPGA}} | + | {{Cl|10 |10/11 | 2,4 | Eficiência de Circuitos Sequenciais | Lab. Programação, Kits FPGA}} |
− | {{Cl|11 | | + | {{Cl|11 |11/11 | 2 | Eficiência de Máquinas de Estados | Lab. Programação, Kits FPGA}} |
− | {{Cl|12 | | + | {{Cl|12 |17/11 | 2,4 | Eficiência de Máquinas de Estados | Lab. Programação, Kits FPGA}} |
− | {{Cl|13 |24/11 | 2 | Register Transfer Metodology | Lab. Programação, Kits FPGA}} | + | {{Cl|13 |24/11 | 2,4 | Register Transfer Metodology | Lab. Programação, Kits FPGA}} |
− | {{Cl|14 | | + | {{Cl|14 |25/11 | 2 | Register Transfer Metodology | Lab. Programação, Kits FPGA}} |
− | {{Cl|15 | | + | {{Cl|15 |1/12 | 2 | Register Transfer Metodology | Lab. Programação, Kits FPGA}} |
{{Cl|16 |8/12 | 2 | Projeto Hierárquico | Lab. Programação, Kits FPGA}} | {{Cl|16 |8/12 | 2 | Projeto Hierárquico | Lab. Programação, Kits FPGA}} | ||
− | {{Cl|17 | | + | {{Cl|17 |9/12 | 2 | Projeto Parametrizado | Lab. Programação, Kits FPGA}} |
− | {{Cl|18 | | + | {{Cl|18 |15/12 | 2 | Clock e Sincronização | Lab. Programação, Kits FPGA}} |
{{Cl|19 |22/12 | 2 | Clock e Sincronização | Lab. Programação, Kits FPGA}} | {{Cl|19 |22/12 | 2 | Clock e Sincronização | Lab. Programação, Kits FPGA}} | ||
{{Cl|20 |2/2 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} | {{Cl|20 |2/2 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} | ||
− | {{Cl|21 | | + | {{Cl|21 |10/2 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} |
{{Cl|22 |16/2 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} | {{Cl|22 |16/2 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} | ||
− | {{Cl|23 | | + | {{Cl|23 |23/2 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} |
− | {{Cl|24 | | + | {{Cl|24 |24/2 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} |
{{Cl|25 |1/3 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} | {{Cl|25 |1/3 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} | ||
− | {{Cl|26 | | + | {{Cl|26 |8/3 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} |
− | {{Cl|27 | | + | {{Cl|27 |9/3 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} |
{{Cl|28 |15/3 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} | {{Cl|28 |15/3 | 2 | Projeto Final | Lab. Programação, Kits FPGA}} | ||
− | |||
{{cronograma-botton |54,2 horas}} | {{cronograma-botton |54,2 horas}} | ||
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Edição das 12h16min de 26 de outubro de 2015
Semestre 2015-2 - Prof. Arliones Hoeller e Prof. Marcos Moecke | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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Semestre 2015-1 - Prof. Arliones Hoeller e Prof. Marcos Moecke | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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