Mudanças entre as edições de "Cronograma de atividades (DLP2-EngTel)"
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− | {{collapse top| bg=lightgreen | expand=true | Semestre 2016-1 - Profs. Arliones Hoeller e Marcos Moecke}} | + | {{collapse top| bg=lightgreen | expand=true | Semestre 2017-1 - Profs. Arliones Hoeller e Marcos Moecke}} |
+ | {{Cronograma-top}} | ||
+ | {{Cl|1 |14/2 | 2 | UN1 - Apresentação do curso, Projeto de sistemas digitais complexos | Lab Programação}} | ||
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+ | {{Cl|4 |7/3 | 2 | UN2 - Processadores embarcados e depuração em FPGA | Lab Programação}} | ||
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+ | {{Cl|6 |15/3 | 2 | UN1 - Processo de Síntese do código VDHL | Lab Programação}} | ||
+ | {{Cl|7 |21/3 | 2 | UN1 - Processo de Síntese do código VDHL: Analise das temporizações | Lab Programação}} | ||
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+ | {{Cl|10 |4/4 | 2 | UN3 - Projeto de circuitos combinacionais eficientes - Indicação dos tempos de propagação no Chip Planner e uso de Logic lock | Lab Programação}} | ||
+ | {{Cl|11 |11/4 | 2 | UN4 - Projeto de circuitos sequenciais eficientes | Lab Programação}} | ||
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+ | {{Cl|17 |9/5 | 2 | UN5 - Máquinas de estados finitos | Lab Programação}} | ||
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+ | {{Cl|23 |6/6 | 2 | UN6 - Register Transfer Methodology | Lab Programação}} | ||
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+ | {{Cl|27 |21/6 | 2 | UN8 - Clock e Sincronização | Lab Programação}} | ||
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+ | {{Cl|29 |4/7 | 2 | Finalização de Trabalhos | Lab Programação}} | ||
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+ | {{collapse top | Semestre 2016-2 - Profs. Arliones Hoeller e Marcos Moecke}} | ||
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+ | {{Cl|1 |10/8 | 2 | UN1 - Apresentação do curso, Projeto de sistemas digitais complexos | Lab Programação}} | ||
+ | {{Cl|2 |15/8 | 2 | UN1 - Processo de Síntese do código VDHL | Lab Programação}} | ||
+ | {{Cl|3 |17/8 | 2 | UN1 - Processo de Síntese do código VDHL: Analise das temporizações | Lab Programação}} | ||
+ | {{Cl|4 |24/8 | 2 | UN2 - Processadores embarcados e depuração em FPGA | Lab Programação}} | ||
+ | {{Cl|5 |29/8 | 2 | UN2 - Processadores embarcados e depuração em FPGA | Lab Programação}} | ||
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+ | {{Cl|7 |10/9 | 2 | UN2 - Processadores embarcados e depuração em FPGA (Sabado) | Lab Programação}} | ||
+ | {{Cl|8 |12/9 | 2 | UN2 - Processadores embarcados e depuração em FPGA | Lab Programação}} | ||
+ | {{Cl|9 |14/9 | 2 | UN2 - Processadores embarcados e depuração em FPGA | Lab Programação}} | ||
+ | {{Cl|10 |21/9 | 2 | UN3 - Projeto de circuitos combinacionais eficientes | Lab Programação}} | ||
+ | {{Cl|11 |26/9 | 2 | UN3 - Projeto de circuitos combinacionais eficientes | Lab Programação}} | ||
+ | {{Cl|12 |28/9 | 2 | UN3 - Projeto de circuitos combinacionais eficientes - Indicação dos tempos de propagação no Chip Planner e uso de Logic lock | Lab Programação}} | ||
+ | {{Cl|13 |5/10 | 2 | UN4 - Projeto de circuitos sequenciais eficientes | Lab Programação}} | ||
+ | {{Cl|14 |10/10 | 2 | UN4 - Projeto de circuitos sequenciais eficientes | Lab Programação}} | ||
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+ | {{Cl|17 |26/10 | 2 | UN4 - Projeto de circuitos sequenciais eficientes | Lab Programação}} | ||
+ | {{Cl|18 |7/11 | 2 | UN4 - Projeto de circuitos sequenciais eficientes | Lab Programação}} | ||
+ | {{Cl|19 |9/11 | 2 | UN5 - Máquinas de estados finitos | Lab Programação}} | ||
+ | {{Cl|20 |16/11 | 2 | UN5 - Máquinas de estados finitos | Lab Programação}} | ||
+ | {{Cl|21 |21/11 | 2 | UN5 - Máquinas de estados finitos | Lab Programação}} | ||
+ | {{Cl|22 |23/11 | 2 | UN5 - Máquinas de estados finitos | Lab Programação}} | ||
+ | {{Cl|23 |30/11 | 2 | UN6 - Register Transfer Methodology | Lab Programação}} | ||
+ | {{Cl|24 |5/12 | 2 | UN6 - Register Transfer Methodology | Lab Programação}} | ||
+ | {{Cl|25 |7/12 | 2 | UN6 - Register Transfer Methodology | Lab Programação}} | ||
+ | {{Cl|26 |14/12 | 2 | UN7 - Projeto Hierárquico e parametrizado | Lab Programação}} | ||
+ | {{Cl|27 |17/12 | 2 | UN7 - Projeto Hierárquico e parametrizado (sábado 20% EAD) | Lab Programação}} | ||
+ | {{Cl|28 |19/12 | 2 | UN7 - Projeto Hierárquico e parametrizado | Lab Programação}} | ||
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+ | {{collapse top | Semestre 2016-1 - Profs. Arliones Hoeller e Marcos Moecke}} | ||
{{Cronograma-top-aulas}} | {{Cronograma-top-aulas}} | ||
{{Cl|1 |22/3 | 2 | Gerenciamento de Complexidade e Visão Geral de Sistemas Digitais Complexos | Lab. Programação}} | {{Cl|1 |22/3 | 2 | Gerenciamento de Complexidade e Visão Geral de Sistemas Digitais Complexos | Lab. Programação}} | ||
Linha 22: | Linha 90: | ||
{{Cl|20 |14/6 | 2 | Register Transfer Metodology | Lab. Programação}} | {{Cl|20 |14/6 | 2 | Register Transfer Metodology | Lab. Programação}} | ||
{{Cl|21 |16/6 | 2 | Register Transfer Metodology | Lab. Programação}} | {{Cl|21 |16/6 | 2 | Register Transfer Metodology | Lab. Programação}} | ||
− | {{Cl|22 |21/6 | 2 | Laboratório: Componente | + | {{Cl|22 |21/6 | 2 | Laboratório: Componente utilizando RTM | Lab. Programação}} |
− | {{Cl|23 |28/6 | 2 | Laboratório: Componente | + | {{Cl|23 |28/6 | 2 | Laboratório: Componente utilizando RTM | Lab. Programação}} |
{{Cl|24 |30/6 | 2 | Projeto Hierárquico e Parametrização | Lab. Programação}} | {{Cl|24 |30/6 | 2 | Projeto Hierárquico e Parametrização | Lab. Programação}} | ||
{{Cl|25 |5/7 | 2 | Projeto Hierárquico e Parametrização | Lab. Programação}} | {{Cl|25 |5/7 | 2 | Projeto Hierárquico e Parametrização | Lab. Programação}} |
Edição atual tal como às 09h32min de 7 de março de 2017
Semestre 2017-1 - Profs. Arliones Hoeller e Marcos Moecke | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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Semestre 2016-2 - Profs. Arliones Hoeller e Marcos Moecke | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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Semestre 2016-1 - Profs. Arliones Hoeller e Marcos Moecke | ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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Semestre 2015-2 - Profs. Arliones Hoeller e Marcos Moecke | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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Semestre 2015-1 - Profs. Arliones Hoeller e Marcos Moecke | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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